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馮若依曼,哈佛結(jié)構(gòu),CISC,RISC |
| 作者：zhaoys 欄目：ARM技術(shù) |
馮若依曼,哈佛結(jié)構(gòu), CISC,RISC 有文章說RISC,精簡指令是對哈佛結(jié)構(gòu)來說的,CISC復(fù)雜指令是對馮若依曼結(jié)構(gòu)來說的 不知道對不對. 請問他們有什么對應(yīng)關(guān)系 |
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| 作者： lx_csut 于 2005/8/30 13:07:00 發(fā)布：
應(yīng)該不是吧 如果說RISC,精簡指令是對哈佛結(jié)構(gòu)來說的，那ARM7可是RISC的馮若依曼結(jié)構(gòu)。 |
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| 作者： 笨人 于 2005/8/30 13:30:00 發(fā)布：
沒有必然的聯(lián)系 RISC,CISC是對指令來講的，哈佛結(jié)構(gòu)與馮若依曼結(jié)構(gòu)是對數(shù)據(jù)總線來說的, 它們之間沒有必然的聯(lián)系 |
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| 作者： chunk 于 2005/8/30 13:32:00 發(fā)布：
各位對“并行”這個詞是如何理解的呢？ “哈佛結(jié)構(gòu)”就跟這個詞有關(guān)系。樓主看看計算機發(fā)展史吧。 |
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| 作者： zhiwei 于 2005/8/30 13:40:00 發(fā)布：
我的理解 CISC：復(fù)雜指令集計算機。是說它的指令集復(fù)雜，或者說含有復(fù)雜的指令。例如X86的CPU，把寄存器加法、內(nèi)存取、內(nèi)存存各看作一個微操作的話那么一個寄存器加法指令和一個寄存器與內(nèi)存加法所需的時間就會相差很大后者流水線會拖得很長，造成指令執(zhí)行時間長短不一，流水線效率不高，另外CPU的指令解碼模塊就很復(fù)雜一些。 RISC：精簡指令集計算機。是說它的指令集簡單，一般不是以指令多少來區(qū)分的。RISC的指令一般比較簡單，一般都是單周期指令。流水線利用效率很高，指令解碼設(shè)計也簡單一些，所以價錢也會較低。 馮若依曼：數(shù)據(jù)存儲器和指令存儲器共用。例如X86、MSP430單片機 哈佛：數(shù)據(jù)存儲器和指令存儲器分開，例如MCS51、AVR單片機等 |
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| 作者： zhaoys 于 2005/8/30 17:05:00 發(fā)布：
to zhiwei mcs51,是哈佛結(jié)構(gòu)嗎 ？ |
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| 作者： zbo210 于 2005/8/30 21:53:00 發(fā)布：
不是吧 DSP好像是哈佛結(jié)構(gòu) |
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| 作者： chunk 于 2005/8/31 10:42:00 發(fā)布：
真夠可以的�。。� 馮諾依曼體系是指基于存儲器存儲程序的原理運作的計算機，一切使用存儲器保存程序，CPU從存儲器里取指令執(zhí)行的計算機都是馮諾依曼體系。 如果CPU只有一組總線，那么取指令的時候就不能取數(shù)據(jù)，取數(shù)據(jù)時就不能取指令。流水線上就會有STALL狀態(tài)，這就限制了程序的運行速度。我們把總線分成獨立的兩組：一組連接程序存儲器，一組連接數(shù)據(jù)存儲器，這樣取數(shù)據(jù)和取指令就可以“并行”，計算速度得以提高，這種具有分離的程序/數(shù)據(jù)存儲器總線的結(jié)構(gòu)就是“哈佛結(jié)構(gòu)”。 MCS51不是哈佛結(jié)構(gòu)，它只有一組地址/數(shù)據(jù)總線，控制總線到是分成了RD/WR和PSEN，但并不能提高性能。 X86原來不是哈佛結(jié)構(gòu)，現(xiàn)在是。因為CPU內(nèi)部有兩個CACHE，指令CACHE和數(shù)據(jù)CACHE。 現(xiàn)在大家是不是應(yīng)該能理解為什么高級的微處理器都把內(nèi)部CACHE分成指令/數(shù)據(jù)兩個部分了吧？？ |
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| 9樓： | >>參與討論 |
| 作者： liaozhihua 于 2005/8/31 10:46:00 發(fā)布：
目前CPU運行的思想還沒有超出馮.諾依曼的思想... |
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