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一個CPLD下載以后的問題 |
| 作者：li_wang 欄目：EDA技術(shù) |
在我的設(shè)計中，CLKIN是一個時鐘輸入，我把它定義在GCK上，在設(shè)計中用到CLKIN作為同步時鐘信號，也把它作為一個PAD直接輸出，具體應(yīng)用如下 library ieee; use ieee.std_logic_1164.all; entity m is PORT( reset: in std_logic; clkin: in std_logic; .... clkout : out std_logic; x: out std_logic)); end m; architecture archm of m is begin mu: PROCESS (reset, clkin, c, d) begin ...... end PROCESS mu; clkout <= not clkin; x <= not clkin; end archm; 可是下載以后出現(xiàn)一個很奇怪的問題，X出現(xiàn)的結(jié)果是對的，可是CLKOUT出現(xiàn)的結(jié)果就有時候?qū)Γ袝r候不對，是不是在XILINX的CPLD中有什么設(shè)置，我用的是ISE6。2 |
| 2樓： | >>參與討論 |
| 作者： jacksun07 于 2005/7/7 21:43:00 發(fā)布：
應(yīng)該沒什么問題吧？ 應(yīng)該沒什么問題吧？ |
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| 3樓： | >>參與討論 |
| 作者： li_wang 于 2005/7/8 9:43:00 發(fā)布：
確實有 |
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