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P3.3的上拉電阻是多大啊？我接了一個(gè)１０Ｋ還拉不下去 |
| 作者：eling 欄目：單片機(jī) |
| 2樓： | >>參與討論 |
| 作者： northerns 于 2005/6/15 9:21:00 發(fā)布：
??????? |
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| 3樓： | >>參與討論 |
| 作者： eling 于 2005/6/15 9:23:00 發(fā)布：
內(nèi)部的上拉 |
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| 4樓： | >>參與討論 |
| 作者： sjnh 于 2005/6/15 9:27:00 發(fā)布：
可能有別的問(wèn)題 10K完全可以 |
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| 5樓： | >>參與討論 |
| 作者： meng730507 于 2005/6/15 10:53:00 發(fā)布：
一般是100K左右吧！ 要仔細(xì)看看你的型號(hào)。不同型號(hào)，差別可能性比較大。 |
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| 6樓： | >>參與討論 |
| 作者： gdtyy 于 2005/6/15 11:34:00 發(fā)布：
上拉下拉電路設(shè)計(jì)詳解 1、有些老外給的DEMO設(shè)計(jì)是故意騙人的，千萬(wàn)不要上當(dāng)，10K是弱上拉，電流很小，信噪比低，即使勉強(qiáng)能上拉，做出的系統(tǒng)也不可靠。同樣下拉用1K才有效。如果圖紙上給出更小的阻值，比如：510歐下拉，那就用小的，老外在這點(diǎn)上是很實(shí)成的，當(dāng)他給出比1K小的下拉，那可以確信地說(shuō)，1K肯定拉不下來(lái)。 2、堅(jiān)決不使用內(nèi)上/下拉，視其不存在。you koow，在芯片里做電阻非常不容易，一般要用晶體管或場(chǎng)效應(yīng)管做，電阻奇大無(wú)比且不易做準(zhǔn)(易受溫度影響而變化)，很難做小電阻，導(dǎo)致弱上/下拉，稍有風(fēng)吹草動(dòng)，就會(huì)出錯(cuò)。而且系統(tǒng)的穩(wěn)定不能寄托在別人的芯片穩(wěn)定上，那會(huì)很被動(dòng)，由于芯片批次不同，你的系統(tǒng)穩(wěn)定性嚴(yán)重依賴于芯片廠商。另外，加入外部上下拉，可以避免疑神疑鬼，至少外部信號(hào)是確定值，便于迅速定位問(wèn)題。 3、為什么固定使用4.7K和1K，因?yàn)殡娮璧淖柚凳请x散的，只能選擇離散點(diǎn)上值，就好像人民幣面值沒(méi)有70元的，只能用50元和20元拼湊。一旦上下拉標(biāo)準(zhǔn)確定，采購(gòu)時(shí)容易上批量，大家交流也方便，另外便于生產(chǎn)，因?yàn)樘瑱C(jī)的飛梭盤數(shù)目有限，如果器件種類過(guò)多，就要頻繁換盤，耽誤生產(chǎn)時(shí)間。 4、不用引腳不可懸空，F(xiàn)PGA的IO腳除外。TTL器件可以懸空，CMOS器件輸入懸空會(huì)靜電擊穿，輸出懸空會(huì)閂鎖，CMOS就是這么怪，有時(shí)系統(tǒng)運(yùn)行不正常了，放一段時(shí)間又好了，八成是輸出懸空了。內(nèi)部帶上下拉的器件也不能懸空，理由如上2，非不能也，實(shí)不信也。 5、不能直接接電源上拉或地下拉，否則會(huì)有倒灌和過(guò)流危險(xiǎn)，功耗也大。 總之，上拉用4.7K，下拉用1K，忽略內(nèi)部上下拉，未用引腳不懸空，不直接接電地。 4.7K上拉和1K下拉，兼顧了功耗和穩(wěn)定性，重點(diǎn)是穩(wěn)定性(不是實(shí)驗(yàn)室穩(wěn)定，而是惡劣現(xiàn)場(chǎng)穩(wěn)定)，這種阻值的功耗很小，如果想進(jìn)一步降低功耗，應(yīng)選用低壓器件并降低運(yùn)行頻率。 用10K/20K上下拉，用內(nèi)部上下拉，不論何種原因的懸空引腳，系統(tǒng)皆不可能可靠。 * - 本貼最后修改時(shí)間：2005-6-15 14:45:46 修改者：gdtyy |
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| 7樓： | >>參與討論 |
| 作者： isoar 于 2005/6/15 11:58:00 發(fā)布：
考慮省電時(shí)，我常用10k或更大的上拉，沒(méi)見(jiàn)有什么不穩(wěn)��？ |
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