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在testbench中怎么定義與雙向總線相對(duì)應(yīng)的端口信號(hào)？ |
| 作者：kimjin 欄目：IC設(shè)計(jì) |
我在設(shè)計(jì)中使用了雙向總線，inout [3:0] data_bus; 在testbench中定義了與之對(duì)應(yīng)的寄存器變量：reg [3:0] data_bus; modelsim中編譯正常，但是load時(shí)報(bào)錯(cuò)： # ** Error: (vsim-3053) E:/vhd/bidir_bus/bidir_bus_test.v(14): Illegal OUTPUT or inout PORT connection (PORT 'data_bus'). # Region: /bidir_bus_test/u1 # Error loading design 請(qǐng)問正確的仿真雙向總線的方法是什么？ 謝謝。 |
| 2樓： | >>參與討論 |
| 作者： asunmad 于 2005/4/18 13:46:00 發(fā)布：
把它定義為wire，用assign語句賦值。 另外定義一個(gè)REG來保存值。 |
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| 3樓： | >>參與討論 |
| 作者： wzg 于 2005/4/19 11:42:00 發(fā)布：
同意樓上的 樓上的說的對(duì) 就是拆開來定義就可以了，雙向總線分開定義，一個(gè)定義為INPUT，一個(gè)定義為OUTPUT，好好想想，看一下雙向總線設(shè)計(jì)的電路。 |
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| 4樓： | >>參與討論 |
| 作者： aluzi 于 2005/6/1 21:03:00 發(fā)布：
哈哈哈,想想真實(shí)環(huán)境... 肯定需要OUTPUT enable |
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| 5樓： | >>參與討論 |
| 作者： andison 于 2005/6/1 21:14:00 發(fā)布：
asunmad正解，我也碰到過這個(gè)問題。 |
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| 6樓： | >>參與討論 |
| 作者： nbosbwp 于 2005/6/3 17:26:00 發(fā)布：
一般輸入輸出 分開，到外面做三態(tài)的。 |
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| 7樓： | >>參與討論 |
| 作者： falconking 于 2005/6/3 20:28:00 發(fā)布：
支持 nbosbwp 的觀點(diǎn) 同題 |
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| 8樓： | >>參與討論 |
| 作者： hope_xi 于 2005/6/7 18:27:00 發(fā)布：
雙向總線 用二樓的方法，絕對(duì)可以！ 去試試吧！ |
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