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5B6B碼的時鐘提取如何在FPGA上實現(xiàn)？ |
| 作者：yinjun 欄目：通信技術(shù) |
如何在FPGA上實現(xiàn)5B6B碼的接收時鐘提取，數(shù)據(jù)恢復(fù)？ |
| 2樓： | >>參與討論 |
| 作者： samsong 于 2005/6/2 12:37:00 發(fā)布：
數(shù)據(jù)回復(fù)可以，時鐘提取要看你的頻率 |
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| 3樓： | >>參與討論 |
| 作者： yinjun 于 2005/6/2 16:17:00 發(fā)布：
不提取時鐘，如何恢復(fù)數(shù)據(jù)？ |
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| 4樓： | >>參與討論 |
| 作者： mcudds 于 2005/6/4 13:18:00 發(fā)布：
是不是按輸入的數(shù)據(jù)位提取再鎖相 |
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| 5樓： | >>參與討論 |
| 作者： zhufigo 于 2005/6/4 23:11:00 發(fā)布：
? 先要提取時鐘，才能恢復(fù)數(shù)據(jù)吧。 用PLL |
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| 6樓： | >>參與討論 |
| 作者： yinjun 于 2005/6/5 8:47:00 發(fā)布：
不知有哪位高手如何實現(xiàn)？ |
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