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請(qǐng)問(wèn)cpld的時(shí)鐘信號(hào)需要從外部輸入嗎？選多大頻率？ |
| 作者：liujin911 欄目：EDA技術(shù) |
新手，請(qǐng)多指教！我選的cpld的型號(hào)為EPM7128SLC84-15，看到資料上有兩個(gè)GCLK輸入端，應(yīng)該從哪個(gè)端口輸入時(shí)鐘？是用有源晶振嗎？應(yīng)該選多大頻率的？能給個(gè)電路嗎？謝謝！ |
| 2樓： | >>參與討論 |
| 作者： xubanghui 于 2005/5/26 17:46:00 發(fā)布：
兩個(gè)輸入均可 兩個(gè)輸入均可，看你設(shè)計(jì)需要，輸入頻率我作過(guò)該芯片試驗(yàn)，80MHZ沒(méi)問(wèn)題。輸入信號(hào)為方波。 |
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| 3樓： | >>參與討論 |
| 作者： monisfic 于 2005/5/26 18:23:00 發(fā)布：
建議閱讀MAX7000資料料手冊(cè) 里面有GCLK的內(nèi)部框圖及工作原理. 可以加深你對(duì)GCLK的理解. 理論上講從任何一個(gè)用戶IO都可以輸入時(shí)鐘 但這會(huì)帶來(lái)附加延時(shí),導(dǎo)致輸入頻率上限降低 且邏輯綜合時(shí)比較耗資源~!!^^^^^ |
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| 4樓： | >>參與討論 |
| 作者： liujin911 于 2005/5/26 19:46:00 發(fā)布：
非常感謝！ |
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