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[求助] Verilog HDL 數(shù)字鐘設(shè)計(jì)原理（有程序更好） |
| 作者：kane_cx 欄目：EDA技術(shù) |
最近在學(xué)Verilog HDL，相信這個(gè)很多人再熟悉不過了，如果哪位大哥有這個(gè)資料，麻煩發(fā)給小弟,感激不盡！ kanecx@163.com |
| 2樓： | >>參與討論 |
| 作者： 代成志 于 2005/5/26 11:42:00 發(fā)布：
去找一個(gè)書來看看吧！ |
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| 3樓： | >>參與討論 |
| 作者： rickyice 于 2005/5/26 12:16:00 發(fā)布：
re 很多書上都有 |
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