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請(qǐng)教這個(gè)警告是什么意思，是怎么引起的？ |
| 作者：bluefancy 欄目：EDA技術(shù) |
源程序： library ieee; use ieee.std_LOGIC_1164.all; use ieee.std_LOGIC_arith.all; use ieee.std_LOGIC_unsigned.all; --********************************************* entity Counter106 is PORT( PPS_Rst: in std_LOGIC; KEEP: in std_LOGIC; CP: in std_LOGIC; LatchValue: out std_LOGIC_vector(19 downto 0); EndValue: out std_LOGIC_vector(19 downto 0) -- LatchFlag: out std_LOGIC ); end Counter106; --********************************************* architecture a of Counter106 is signal QQ: std_LOGIC_vector(19 downto 0); begin P1:PROCESS(PPS_Rst,CP,QQ) begin if CP'event and CP='1' then if PPS_Rst='1' then EndValue<=QQ; QQ<="00000000000000000000"; else QQ<=QQ+1; end if; end if; end PROCESS P1; P2:PROCESS(KEEP,PPS_Rst,QQ) begin if KEEP'event and KEEP<='1' then if PPS_Rst='1' then LatchValue<="00000000000000000000"; else LatchValue<=QQ; end if; end if; end PROCESS P2; end a; /////////////////////////////////////////////////////// Warning: Design contains 1 input pin(s) that do not drive LOGIC Warning: No OUTPUT dependent on input pin "KEEP" |
| 2樓： | >>參與討論 |
| 作者： xjg1111 于 2005/1/7 19:58:00 發(fā)布：
re 不懂ＶＨＤＬ， 但警告的意思是你的KEEP腳不能“驅(qū)動(dòng)”（也不知道翻譯成什么好）后級(jí)的邏輯，相當(dāng)于這個(gè)腳沒接，仔細(xì)看看你的代碼，應(yīng)該能找到原因。 |
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| 3樓： | >>參與討論 |
| 作者： szbaiyong 于 2005/1/8 10:30:00 發(fā)布：
我也不懂ＶＨＤＬ |
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| 4樓： | >>參與討論 |
| 作者： 小強(qiáng)_高 于 2005/1/8 16:56:00 發(fā)布：
輸入引腳KEEP沒有使用 |
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| 5樓： | >>參與討論 |
| 作者： huangfujun 于 2005/1/8 20:49:00 發(fā)布：
RE： 輸入引腳KEEP沒有使用。 |
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| 6樓： | >>參與討論 |
| 作者： picklas 于 2005/1/8 21:06:00 發(fā)布：
re 樓上說的不錯(cuò)，就是你的KEEP信號(hào)沒有使用，被綜合器給優(yōu)化了：〉 if KEEP'event and KEEP<='1' then 根本就沒用，是不是應(yīng)該 if KEEP'event and KEEP='1' then ？？ |
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| 7樓： | >>參與討論 |
| 作者： bluefancy 于 2005/1/8 22:19:00 發(fā)布：
我明白了，謝謝斑竹和各位了，是我自己粗心犯的錯(cuò)誤！ |
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