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EPM240T100C5N Datasheet

  • EPM240T100C5N

  • MAX II ISP CPLD 240, TQFP100, 240; CPLD Type:FLASH; No. of M...

  • 1035.40KB

  • 101頁

  • Altera   Altera

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Chapter 2: MAX II Architecture
Functional Description
2鈥?
Table 2鈥?.
MAX II Device Resources
LAB Rows
Devices
EPM240
EPM570
EPM1270
EPM2210
Note to
Table 2鈥?:
(1) The width is the number of LAB columns in length.
UFM Blocks
1
1
1
1
LAB Columns
6
12
16
20
Long LAB Rows
4
4
7
10
Short LAB Rows
(Width)
(1)
鈥?/div>
3 (3)
3 (5)
3 (7)
Total LABs
24
57
127
221
Figure 2鈥?
shows a floorplan of a MAX II device.
Figure 2鈥?.
MAX II Device Floorplan
(Note 1)
I/O Blocks
I/O Blocks
Logic Array
Blocks
Logic Array
Blocks
2 GCLK
Inputs
I/O Blocks
2 GCLK
Inputs
UFM Block
CFM Block
Note to
Figure 2鈥?:
(1) The device shown is an EPM570 device. EPM1270 and EPM2210 devices have a similar floorplan with more LABs. For EPM240 devices, the CFM
and UFM blocks are located on the left side of the device.
漏 October 2008
Altera Corporation
MAX II Device Handbook

EPM240T100C5N 產(chǎn)品屬性

  • 270

  • 集成電路 (IC)

  • 嵌入式 - CPLD（復(fù)雜可編程邏輯器件）

  • MAX® II

  • 系統(tǒng)內(nèi)可編程

  • 4.7ns

  • 2.5V，3.3V

  • 240

  • 192

  • -

  • 80

  • 0°C ~ 85°C

  • 表面貼裝

  • 100-TQFP

  • 100-TQFP（14x14）

  • 托盤

  • 544-1964EPM240T100C5N-ND

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