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EPM240T100C5 Datasheet

  • EPM240T100C5

  • CPLD MAX II Family 192 Macro Cells 1879.7MHz 0.18um Technolo...

  • 1035.40KB

  • 101頁

  • Altera   Altera

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Chapter 2: MAX II Architecture
User Flash Memory Block
2鈥?1
Figure 2鈥?6.
EPM240 UFM Block LAB Row Interface
(Note 1)
CFM Block
UFM Block
LAB
PROGRAM
ERASE
OSC_ENA
RTP_BUSY
LAB
DRDin
DRCLK
DRSHFT
ARin
ARCLK
ARSHFT
DRDout
OSC
BUSY
LAB
Note to
Figure 2鈥?6:
(1) The UFM block inputs and outputs can drive to/from all types of interconnects, not only DirectLink interconnects from adjacent row LABs.
漏 October 2008
Altera Corporation
MAX II Device Handbook

EPM240T100C5 產(chǎn)品屬性

  • 270

  • 集成電路 (IC)

  • 嵌入式 - CPLD(復(fù)雜可編程邏輯器件)

  • MAX® II

  • 系統(tǒng)內(nèi)可編程

  • 4.7ns

  • 2.5V,3.3V

  • 240

  • 192

  • -

  • 80

  • 0°C ~ 85°C

  • 表面貼裝

  • 100-TQFP

  • 100-TQFP(14x14)

  • 托盤

  • 544-1146

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