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MM74C32N Datasheet

  • MM74C32N

  • Quad 2-Input OR Gate

  • 4頁(yè)

  • NSC

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MM54C32 MM74C32 Quad 2-Input OR Gate
February 1988
MM54C32 MM74C32 Quad 2-Input OR Gate
General Description
Employing complementary MOS (CMOS) transistors to
achieve low power and high noise margin these gates pro-
vide the basic functions used in the implementation of digital
integrated circuit systems The N- and P-channel enhance-
ment mode transistors provide a symmetrical circuit with
output swings essentially equal to the supply voltage This
results in high noise immunity over a wide supply voltage
range No DC power other than that caused by leakage cur-
rent is consumed during static conditions All inputs are pro-
tected against static discharge damage
Features
Y
Y
Y
Y
Wide supply voltage range
Guaranteed noise margin
High noise immunity
Low power
TTL compatibility
3 0V to 15V
1 0V
0 45V V
CC
(typ )
fan out of 2
driving 74L
Connection Diagram
Dual-In-Line Package
TL F 5881 鈥?1
Top View
Order Number MM54C32 or MM74C32
C
1995 National Semiconductor Corporation
TL F 5881
RRD-B30M105 Printed in U S A

MM74C32N 產(chǎn)品屬性

  • 25

  • 集成電路 (IC)

  • 邏輯 - 柵極和逆變器

  • 74C

  • 或門(mén)

  • 4

  • 2

  • -

  • 3 V ~ 15 V

  • -

  • 8mA，8mA

  • 1.5 V ~ 2 V

  • 3.5 V ~ 8 V

  • 70ns @ 10V，50pF

  • -55°C ~ 125°C

  • 通孔

  • 14-DIP

  • 14-DIP（0.300"，7.62mm）

  • 管件

  • 74C3274C32N

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