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74LVQ241SJ Datasheet

  • 74LVQ241SJ

  • Low Voltage Octal Buffer/Line Driver with 3-STATE Outputs

  • 6頁

  • FAIRCHILD

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74LVQ241 Low Voltage Octal Buffer/Line Driver with 3-STATE Outputs
February 1992
Revised June 2001
74LVQ241
Low Voltage Octal Buffer/Line Driver
with 3-STATE Outputs
General Description
The LVQ241 is an octal buffer and line driver designed to
be employed as a memory address driver, clock driver and
bus oriented transmitter or receiver which provides
improved PC board density.
Features
s
Ideal for low power/low noise 3.3V applications
s
Implements patented EMI reduction circuitry
s
Available in SOIC JEDEC, SOIC EIAJ and QSOP pack-
ages
s
Guaranteed simultaneous switching noise level and
dynamic threshold performance
s
Improved latch-up immunity
s
Guaranteed incident wave switching into 75
鈩?/div>
s
4 kV minimum ESD immunity
Ordering Code:
Order Number
74LVQ241SC
74LVQ241SJ
74LVQ241QSC
Package Number
M20B
M20D
MQA20
Package Description
20-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-013, 0.300" Wide
20-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide
20-Lead Quarter Size Outline Package (QSOP), JEDEC MO-137, 0.150" Wide
Device also available in Tape and Reel. Specify by appending suffix letter 鈥淴鈥?to the ordering code.
Logic Diagram
IEEE/IEC
Connection Diagram
Truth Tables
Inputs
OE
1
I
n
L
H
X
Inputs
OE
2
L
H
H
I
n
X
H
L
Outputs
(Pins 12, 14, 16, 18)
L
H
Z
Outputs
(Pins 3, 5, 7, 9)
Z
H
L
Pin Descriptions
Pin Names
OE
1
, OE
2
I
0
鈥揑
7
O
0
鈥揙
7
Description
3-STATE Output Enable Inputs
Inputs
Outputs
L
L
H
H
=
HIGH Voltage Level X
=
Immaterial
L
=
LOW Voltage Level Z
=
High Impedance
漏 2001 Fairchild Semiconductor Corporation
DS011355
www.fairchildsemi.com

74LVQ241SJ 產(chǎn)品屬性

  • 38

  • 集成電路 (IC)

  • 邏輯 - 緩沖器，驅(qū)動器，接收器，收發(fā)器

  • 74LVQ

  • 緩沖器/線路驅(qū)動器，非反相

  • 2

  • 4

  • 12mA，12mA

  • 2 V ~ 3.6 V

  • -40°C ~ 85°C

  • 表面貼裝

  • 20-SOIC（0.209"，5.30mm 寬）

  • 20-SOP

  • 管件

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  • 型號
    版本
    描述
    廠商
    下載
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    Philips
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    Triple 3-input NAND gate
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