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74F825SPC Datasheet

  • 74F825SPC

  • 8-Bit D-Type Flip-Flop

  • 6頁

  • FAIRCHILD

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上傳產(chǎn)品規(guī)格書

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74F825 8-Bit D-Type Flip-Flop
April 1988
Revised August 1999
74F825
8-Bit D-Type Flip-Flop
General Description
The 74F825 is an 8-bit buffered register. It has Clock
Enable and Clear features which are ideal for parity bus
interfacing in high performance microprogramming sys-
tems. Also included in the 74F825 are multiple enables that
allow multi-user control of the interface.
Features
s
3-STATE output
s
Clock enable and clear
s
Multiple output enables
Ordering Code:
Order Number
74F825SC
74F825SPC
Package Number
M24B
N24C
Package Description
24-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-013, 0.300 Wide
24-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-100, 0.300 Wide
Devices also available in Tape and Reel. Specify by appending the suffix letter 鈥淴鈥?to the ordering code.
Logic Symbols
Connection Diagram
IEEE/IEC
漏 1999 Fairchild Semiconductor Corporation
DS009597
www.fairchildsemi.com

74F825SPC 產(chǎn)品屬性

  • 375

  • 集成電路 (IC)

  • 邏輯 - 觸發(fā)器

  • 74F

  • 主復(fù)位

  • D 型總線

  • 三態(tài)非反相

  • 1

  • 8

  • 160MHz

  • 6.5ns

  • 正邊沿

  • 3mA，24mA

  • 4.5 V ~ 5.5 V

  • 0°C ~ 70°C

  • 通孔

  • 24-DIP（0.300"，7.62mm）

  • 管件

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