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74F280PC Datasheet

  • 74F280PC

  • 9-Bit Parity Generator/Checker

  • 5頁

  • FAIRCHILD

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74F280 9-Bit Parity Generator/Checker
April 1988
Revised August 1999
74F280
9-Bit Parity Generator/Checker
General Description
The F280 is a high-speed parity generator/checker that
accepts nine bits of input data and detects whether an
even or an odd number of these inputs is HIGH. If an even
number of inputs is HIGH, the Sum Even output is HIGH. If
an odd number is HIGH, the Sum Even output is LOW. The
Sum Odd output is the complement of the Sum Even out-
put.
Ordering Code:
Order Number
74F280SC
74F280SJ
74F280PC
Package Number
M14A
M14D
N14A
Package Description
14-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-120, 0.150 Narrow
14-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide
14-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide
Devices also available in Tape and Reel. Specify by appending the suffix letter 鈥淴鈥?to the ordering code.
Logic Symbols
Connection Diagram
IEEE/IEC
漏 1999 Fairchild Semiconductor Corporation
DS009512
www.fairchildsemi.com

74F280PC 產(chǎn)品屬性

  • 500

  • 集成電路 (IC)

  • 邏輯 - 奇偶校驗發(fā)生器和校驗器

  • 74F

  • 奇偶校驗發(fā)生器/校驗器

  • 9 位

  • 1mA，20mA

  • 4.5 V ~ 5.5 V

  • 0°C ~ 70°C

  • 通孔

  • 14-DIP（0.300"，7.62mm）

  • 14-DIP

  • 74F280

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