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74F191SJ Datasheet

  • 74F191SJ

  • Up/Down Binary Counter with Preset and Ripple Clock

  • 7頁

  • FAIRCHILD

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74F191 Up/Down Binary Counter with Preset and Ripple Clock
April 1988
Revised July 1999
74F191
Up/Down Binary Counter with Preset and Ripple Clock
General Description
The 74F191 is a reversible modulo-16 binary counter fea-
turing synchronous counting and asynchronous presetting.
The preset feature allows the 74F191 to be used in pro-
grammable dividers. The Count Enable input, the Terminal
Count output and Ripple Clock output make possible a
variety of methods of implementing multistage counters. In
the counting modes, state changes are initiated by the ris-
ing edge of the clock.
Features
s
High-Speed鈥?25 MHz typical count frequency
s
Synchronous counting
s
Asynchronous parallel load
s
Cascadable
Ordering Code:
Order Number
74F191SC
74F191SJ
74F191PC
Package Number
M16A
M16D
N16E
Package Description
16-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-012, 0.150 Narrow
16-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide
16-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide
Devices also available in Tape and Reel. Specify by appending the suffix letter 鈥淴鈥?to the ordering code.
Logic Symbols
Connection Diagram
IEEE/IEC
漏 1999 Fairchild Semiconductor Corporation
DS009495
www.fairchildsemi.com

74F191SJ 產品屬性

  • 47

  • 集成電路 (IC)

  • 邏輯 -計數器，除法器

  • 74F

  • 二進制計數器

  • 上，下

  • 1

  • 4

  • -

  • 同步

  • 100MHz

  • 正邊沿

  • 4.5 V ~ 5.5 V

  • 0°C ~ 70°C

  • 表面貼裝

  • 16-SOIC（0.209"，5.30mm 寬）

  • 16-SOIC

  • 管件

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