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74F112SJ Datasheet

  • 74F112SJ

  • Dual JK Negative Edge-Triggered Flip-Flop

  • 59.08KB

  • 6 Pages頁

  • FAIRCHILD [Fairchild Semiconductor]

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上傳產(chǎn)品規(guī)格書

74F112SJ 產(chǎn)品屬性

  • 47

  • 集成電路 (IC)

  • 邏輯 - 觸發(fā)器

  • 74F

  • 設(shè)置（預(yù)設(shè)）和復(fù)位

  • JK 型

  • 差分

  • 2

  • 1

  • 105MHz

  • 5ns

  • 負(fù)邊沿

  • 1mA，20mA

  • 4.5 V ~ 5.5 V

  • 0°C ~ 70°C

  • 表面貼裝

  • 16-SOIC（0.209"，5.30mm 寬）

  • 管件

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