深度剖析:3.3V 與 5V 電平轉換方法、原理、測試及案例
出處:網絡整理 發(fā)布于:2025-08-07 15:20:29 | 1297 次閱讀
電路圖設計及注意事項

在設計使用 NMOS 管進行電平轉換的電路時,需要特別注意 NMOS 管的連接方式。NMOS 管的 Source 端應接低電平側,Drain 端接高電平側,否則通過 NMOS 體二極管可能會存在漏電現象。

如圖所示,SDA1/SCL1,SDA2/SCL2 為 I2C 的兩個信號端,VDD1 和 VDD2 為這兩個信號的高電平電壓。該電路的應用限制條件如下:
對于 3.3V 和 5V/12V 等電路的相互轉換,NMOS 管選擇 AP2306 或者 SI2306 即可。
電路原理分析
沒有器件下拉總線線路
3.3V 部分的總線線路通過上拉電阻 Rp 上拉至 3.3V。此時,NMOS 管的柵極和源極都是 3.3V,所以它的 Vgs 低于閥值電壓,NMOS 管不導通。這就允許 5V 部分的總線線路通過它的上拉電阻 Rp 上拉到 5V。此時兩部分的總線線路都是高電平,只是電壓電平不同。
一個 3.3V 器件下拉總線線路到低電平
當一個 3.3V 器件將總線線路下拉到低電平時,NMOS 管的源極也變成低電平,而柵極是 3.3V,Vgs 上升高于閥值,NMOS 管開始導通。然后 5V 部分的總線線路通過導通的 NMOS 管被 3.3V 器件下拉到低電平。此時,兩部分的總線線路都是低電平,而且電壓電平相同。

一個 5V 的器件下拉總線線路到低電平
當一個 5V 的器件下拉總線線路到低電平時,NMOS 管的漏極基底二極管導通,源極電壓為基底二極管導通 0.7V,3.3V 部分被下拉直到 Vgs 超過閥值,NMOS 管開始導通。3.3V 部分的總線線路通過導通的 NMOS 管被 5V 的器件進一步下拉到低電平。此時,兩部分的總線線路都是低電平,而且電壓電平相同。

電路優(yōu)點
3.3 向 5V 轉換測試
對這個電路進行測試時,MOS 管采用的是 2N7002 小信號 NMOS,其輸入電容很小,大概幾十 pF。

以下是不同頻率下的測試波形:
案例分析
1.5V MDIO 在低溫下無法正確訪問
由于 MOS 管的 Vth 和 Rds (on) 都受到溫度的影響,因此溫度也會間接影響 MOS 管的導通電壓。具體來說,當溫度升高時,Vth 降低而 Rds (on) 增大,這會導致 MOS 管在相同的 VGS 下更容易導通,但導通后的壓降也會增大。然而,需要注意的是,MOS 管的導通電壓并不是一個簡單的固定值,而是受到多種因素(如 VGS、溫度、溝道長度等)的共同影響。因此,在實際應用中,需要綜合考慮這些因素來確定 MOS 管的導通電壓。
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