兩路輸出負向定時脈沖電路原理圖
出處：tyw 發(fā)布于：2011-09-01 10:39:46 | 1421 次閱讀
如圖所示，該電路的輸入脈沖為正觸發(fā)信號，輸出兩路為負定時脈沖。當觸發(fā)脈沖來時，555復位，輸出低電平，C1通過R2灌入集成塊內(nèi)放電，R2C1的放電時間決定了輸出負向脈沖寬度。當C1上電壓放至低于1/3VDD觸發(fā)電平（2腳）時，555置位，3腳呈高電平，VTl飽和導通，電源對C1充電，因而該電路定時高，占空比可達99%,且波形好。
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